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TMS32C6414EZLZ5E0 - Texas Instruments - FIXED-POINT DIGITALE SIGNALPROZESSOREN

TMS32C6414EZLZ5E0 - Texas Instruments - FIXED-POINT DIGITALE SIGNALPROZESSOREN

TMS32C6414EZLZ5E0 - Texas Instruments - FIXED-POINT DIGITAL SIGNAL PROCESSORS

Produktdetails:

Herkunftsort: PHILIPPINISCH
Markenname: Texas Instruments
Zertifizierung: Lead free / RoHS Compliant
Modellnummer: TMS32C6414EZLZ5E0

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Preis: Contace sales group 1
Verpackung Informationen: Standard Packaging
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Ausführliche Produkt-Beschreibung

Schnelles Detail:

 

FIXED-POINT DIGITALE SIGNALPROZESSOREN

 

 

Beschreibung:

 

Die TMS320C64x™ DSPs (die einschließlich Geräte TMS320C6414, TMS320C6415 und TMS320C6416) sind die leistungsstarkste Generation des Fixpunkts DSP in der Plattform TMS320C6000™ DSP. Das Gerät TMS320C64x™ (C64x™-†) basiert auf der leistungsstarken, modernen VelociTI™-sehr-lang-Anweisungwort (VLIW)-Architektur der zweiten Generation (VelociTI.2™) entwickelt durch Texas Instruments (TI) und macht diese DSPs eine ausgezeichnete Wahl für die Mehrkanal- und Multifunktionsanwendungen. Das C64x™ ist ein Code-kompatibles Mitglied der Plattform C6000™ DSP. Mit Leistung von bis 5760 Million Anweisungen pro Sekunde (MIPS) mit einer Taktfrequenz von 720 MHZ, die kosteneffektiven Lösungen des C64x-Gerät-Angebots zu leistungsstarken DSP-Programmierungsherausforderungen. Die C64x DSPs besitzen die Betriebsflexibilität von Hochgeschwindigkeitsprüfern und die numerische Fähigkeit von Vektorenrechnern.

Der Kernprozessor C64x™ DSP hat 64 universelle Register der 32-Bit-- Wortlänge und acht in hohem Grade unabhängiger Funktions-Einheiten-zwei Multiplikatoren für ein 32-Bit-Ergebnis und sechs arithmetisch-logische Einheiten (ALUs) — mit VelociTI.2™-Erweiterungen. Die VelociTI.2™-Erweiterungen in den acht Funktionseinheiten umfassen neue Anweisungen, die Leistung in den Schlüsselanwendungen zu beschleunigen und den Parallelismus der VelociTI™-Architektur zu verlängern. Das C64x kann vier produzieren 16-Bit multiplizieren-ansammelt (MACs) pro Zyklus für insgesamt 2880 Million Mac pro Sekunde (MMACS) oder acht 8-Bit-Mac pro Zyklus für insgesamt 5760 MMACS. Das C64x DSP hat auch anwendungsspezifische Hardware-Logik, Aufchip Gedächtnis und zusätzliche Aufchip Peripherie, die den anderen Plattformgeräten C6000™ DSP ähnlich sind.

Das Gerät C6416 hat zwei leistungsstarke eingebettete Coprocessors [Viterbi-Decoder Coprocessor (VCP) und Turbo-Decoder Coprocessor (TCP)] das beschleunigen erheblich Kanal-Decodierung Operationen Aufchip. Das VCP, das an CPU-Uhr divided-by-4 funktioniert, kann über 600 7.95-Kbps anpassungsfähigen Kanälen des MultiRate decodieren (AMR) [K = 9, R = 1/3] Sprach. Das VCP stützt Beschränkungslängen K = 5, 6, 7, 8 und 9, Rate R = 1/2, 1/3 und 1/4 und flexible Polynome, bei der Erzeugung harte Entscheidungen oder weiche Entscheidungen. TCP, das an CPU-Uhr funktioniert

divided-by-2 kann bis dreiundvierzig 384-Kbps oder sieben Turbo verschlüsselte Kanäle 2-Mbps decodieren (6 Wiederholungen annehmend). TCP führt den max*log-map Algorithmus ein und ist entworfen, alle Polynome und Rate zu stützen, die durch Drittgenerations- Partnerschafts-Projekte erfordert werden (3GPP und 3GPP2), mit völlig programmierbarer Rahmenlänge und Turbo-interleaver. Decodierungsparameter wie die Anzahl von Wiederholungen und Stoppen von Kriterien sind auch programmierbar. Kommunikationen zwischen dem VCP/TCP und der CPU werden durch den EDMA-Prüfer durchgeführt.

Das C64x verwendet eine Pufferspeicher-ansässige Zwei-Ebenenarchitektur und hat einen starken und verschiedenen Satz Peripherie. Der Programmpufferspeicher des Niveaus 1 (L1P) ist ein direkter aufgezeichneter Pufferspeicher 128-Kbit und der Datenpufferspeicher des Niveaus 1 (L1D) ist ein Satz-vereinigender 2wegpufferspeicher 128-Kbit. Das Gedächtnis des Niveaus 2/der Pufferspeicher (L2) besteht aus einem Raum des Gedächtnisses 8-Mbit, der zwischen Programm und Datenraum geteilt wird. Gedächtnis L2 kann als aufgezeichnetes Gedächtnis oder Kombinationen des Pufferspeichers (bis zu den Bytes 256K) und des aufgezeichneten Gedächtnisses konfiguriert sein. Der Zusatzsatz umfaßt drei abgedämpfte Mehrkanalserielle Schnittstellen (McBSPs); ein 8-Bit-Universaltest und Operationen PHY schließen für Hafen Asynchronous- Transfer Mode(atm)-Sklaven [UTOPIE-Sklave] an (nur C6415/C6416); drei universelle 32-Bit-Timer; eine Benutzer-konfigurierbare 16-Bit-- oder 32-Bit--Wirthafen Schnittstelle (HPI16/HPI32); eine Zusatzkomponentenverbindung (PCI) [nur C6415/C6416]; ein universeller Input/Output Hafen (GPIO) mit 16 GPIO-Stiften; und zwei glueless externe Gedächtnisschnittstellen (64-Bit-EMIFA und 16-Bit-EMIFB-‡), die zur Zusammenschaltung zu den synchronen und asynchronen Gedächtnissen und zu den Peripherie fähig sind.

Das C64x hat einen ganzen Satz Entwicklungswerkzeuge, der umfaßt: ein moderner c-Compiler mit C64x-specific Verbesserungen, ein Versammlungsoptimierer, zum der Programmierung und der Terminplanung und eine Windows™-Debuggerschnittstelle für Sicht in Quellcodedurchführung zu vereinfachen.

 

 

Anwendungen:

 

-- Leistungsstarkste Fixed-Point Digital

Signal-Prozessoren (DSPs)

− 2, 1,67-, 1,39 ns-Anweisungs-Zyklus-mal

− 500-, 600-, Taktfrequenz 720-MHz

− acht 32-Bit-Anweisungen/Zyklus

− achtundzwanzig Operationen/Zyklus

− 4000, 4800, 5760 MIPSS

− völlig Software-Kompatibel mit C62x™

− C6414/15/16 Geräte Pin-Kompatibel

-- VelociTI.2™-Erweiterungen zu VelociTI™

Modernes Sehr-Lang-Anweisung-Wort

(VLIW) Kern TMS320C64x™ DSP

− acht in hohem Grade unabhängige Funktionseinheiten mit VelociTI.2™-Erweiterungen:

− sechs ALUs (32-/40-Bit), jedes stützt einzelnes 32-Bit--, Doppel16-bit oder viererverseilt 8-Bit-Arithmetik pro Taktzyklus

− zwei Multiplikator-Unterstützung

Vier 16 x 16-Bit multipliziert

(32-Bit-Ergebnisse) pro Taktzyklus oder

Acht 8 x 8-Bit multipliziert

(16-Bit-Ergebnisse) pro Taktzyklus

− Nicht-Ausgerichtete Last-Speicher Architektur

− 64 universelle 32-Bit-Register

− Anweisungs-Verpackung verringert Code-Größe

− alle Anweisungen bedingt

-- Befehlsatz-Eigenschaften

− byteadressierbar (Daten 8-/16-/32-/64-Bit)

− 8-Bit-Sammelschutz

− Bit-Feld-Auszug, Satz, freier Raum

− Normalisierung, Sättigung, Stückchen-Zählend

− VelociTI.2™ erhöhte Orthogonalitât

-- Viterbi-Decoder Coprocessor (VCP) [C6416]

− Unterstützungen über Amr 600 7.95-Kbps

− programmierbare Code-Parameter

-- Turbo-Decoder Coprocessor (TCP) [C6416]

− stützt bis 7 2-Mbps oder 43 384-Kbps 3GPP (6 Wiederholungen)

− programmierbare Turbo-Code-und Decodierungs-Parameter

-- Architektur des Gedächtnis-L1/L2

− 128K-Bit (16K-Byte) L1P Programm-Pufferspeicher (verweisen Sie aufgezeichnet)

− 128K-Bit (16K-Byte) L1D Daten cachieren (Satz-2wegvereinigende)

− 8M-Bit (1024K-Byte) L2 vereinheitlichte aufgezeichnetes RAM/Cache (flexible Verteilung)

-- Zwei externe Gedächtnis-Schnittstellen (EMIFs)

− eins 64-Bit (EMIFA), eins 16-Bit (EMIFB)

− Glueless-Schnittstelle zu asynchronem

Gedächtnisse (SRAM und EPROM) und

Synchrone Gedächtnisse (SDRAM,

SBSRAM, ZBT SRAM und Fifo)

− 1280M-Byte zugänglicher externer Gedächtnis-totalraum

-- Erhöhter Direkt-Gedächtnis-Zugang (EDMA)

Prüfer (64 unabhängige Kanäle)

-- Wirt-Hafen Schnittstelle (HPI)

− Benutzer-Konfigurierbare Bus-Breite (32-/16-Bit)

-- 32-Bit/33-MHz, PCI 3.3-V Master/Slave

Schnittstelle passt sich an PCI-Spezifikation 2,2 an

[C6415/C6416]

− drei PCI-Bus-Adreßregister:

Prefetchable-Gedächtnis

Nicht--Prefetchable Gedächtnis Input/Output

− 4e-adrig Schnittstelle Serien-EEPROM

− PCI-Unterbrechungsanforderung unter DSP

Programm-Steuerung

− DSP Unterbrechung über PCI-Input-/Outputzyklus

--Drei abgedämpfte Mehrkanalserielle Schnittstellen

− direktes I/F zu T1/E1, MVIP, SCSA-Verfasser

− bis zu 256 Kanälen jedes

− St.-Bus-Schaltung, AC97-Compatible

− Serienzusatzschnittstelle (SPI)

Kompatibel (Motorola™)

 Drei universelle 32-Bit-Timer

 Universaltest und Operationen PHY

Schnittstelle für ATM (UTOPIE) [C6415/C6416]

− UTOPIE-Niveau 2 Sklaven-ATM-Prüfer

das 8-Bit − übertragen und empfangen Operationen

bis 50 MHZ pro Richtung

− verbraucherbestimmtes Zellformat bis 64 Bytes

 Sechzehn universelle Stifte Inputs/Output (GPIO)

 Flexibler PLL-Taktgeber

 IEEE-1149.1 (JTAG-†)

Grenze-Scan-Kompatibel

-- Gitter-Reihen(bga)-Paket des Ball-532-Pin

(GLZ-, ZLZ- und CLZ-Suffixe), 0,8 Millimeter-Ball

Neigung

 Metallprozeß des Cu-0.13-µm/6-Level (CMOS)

 3.3-V I/Os, 1.2-V/1.25-V intern (500 MHZ)

 3.3-V I/Os, 1.4-V intern (600 und 720 MHZ)

 

 

Spezifikationen:

 

Datenblätter

TMS320C6414-16

Produkt-Fotos

532-FCBGA-ZLZ

Standardpaket

60

Kategorie

Integrierte Schaltungen (ICs)

Familie

Eingebettet - DSP (digitale Signalprozessoren)

Reihe

TMS320C6414T/15T/16T

Verpacken

Behälter

Art

Fixpunkt

Schnittstelle

Wirts-Schnittstelle, McBSP

Taktfrequenz

500MHz

Permanentspeicher

Extern

Auf-Chip RAM

1.03MB

Spannung - Input/Output

3.30V

Spannung - Kern

1.20V

Betriebstemperatur

0°C | 90°C

Montage-Art

Oberflächenberg

Paket/Fall

532-BFBGA, FCBGA

Lieferanten-Gerät-Paket

532-FCBGA (23x23)

 

 

Wettbewerbsvorteil:

 

Garantie: 180 Tage!
Kostenloser Versand: Auftrag über Gewinn $1000 eine freie Versandgebühr
(Warengewicht unter 3Kg), während 20130901-20130930.


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